目录
第一章 绪论
1.1 研究背景
1.2 研究思路和方案分析
1.3 论文的主要工作
第二章 可编程片上系统开发技术
2.1 可编程逻辑器件简介
2.2 可编程片上系统开发软件
2.3 硬件描述语言VHDL简介
第三章 系统的组成及工作原理
3.1 M序列产生器
3.2 QPSK调制解调
3.3.1 多进制相移键控基本原理
3.2.2 QPSK 调制
3.2.3 QPSK 解调
3.2.4 调制解调系统
3.3 卷积码编码译码
3.3.1 纠错编码基础
3.3.2 卷积码编码
3.3.3 卷积码的解码
3.3.4 卷积码编码译码系统
3.4 小型移动通信系统
第四章 硬件部分
第五章 总结
参考文献
致谢
附录1
附录2
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第一章 绪论
1.1 研究背景
近年来，随着半导体工艺技术和设计方法的迅速发展，系统级芯片SOC（System-on-Chip）的设计得以高速发展。但是，由于SOC产品设计具有开发周期相对较长、高成本和高风险等特点，对市场的变化非常敏感，这种得SOC在消费电子、汽车电子、工业设计领域的发展进程仍然缓慢。与此同时，当今的制造工艺能够提供更多更高速的逻辑、更快的I/O和更低价位的新一代可编程逻辑器件，现
场可编程门阵列CPLD（Complex Programmable Logic Device）已然进入嵌入式应用领域，高性能CPLD也不再局限于引进系统粘合逻辑，也可作为SOC平台。由于CPLD的现场可编程特征，它已成为更具灵活性和广泛性发展前景的工业设计平台。
与传统电路设计方法相比，CPLD具有功能强大、开发过程投资小、周期短、便于修改及开发工具智能化等特点。使用CPLD器件设计数字电路，不仅可以简化设计过程，而且可以降低整个系统的体积和成本，增加系统的可靠性。CPLD可轻易地被修改变更、修复缺陷，或在用户需要升级和配合市场发展时去创制未来的衍生产品。它们无需花费传统意义下制造集成电路所需大量时间和精力，避免了投资风险，成为电子器件行业中发展最快的一族。
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